CXL 2.0 / PCIe 5.0ソリューションは、異種のコンピューティングとデータのボトルネックを解消します
ファブレス半導体のスタートアップであるAsteraLabsは、ヘテロジニアスコンピューティングアーキテクチャのロックを解除し、データセンターの遅延に敏感なワークロードに対処するための新しい専用のCXL2.0およびPCIe5.0接続ソリューションを発表しました。同社によれば、これらの新しいソリューションの目的は、データ中心のアプリケーションにおけるシステム全体のパフォーマンスのボトルネックに対処することです。
データの急増と、人工知能(AI)や機械学習(ML)などの特殊なワークロードの主流化には、同じマザーボード上または同じラック内で汎用CPUと並行して動作する専用のアクセラレータが必要です。共通のメモリスペースを共有します。 CXL 2.0相互接続は、このようなキャッシュコヒーレントシステムトポロジを実現するための鍵です。
Astera Labsの新しいポートフォリオの最初の製品は、低遅延のCXL.io接続用のAries Compute Express Link(CXL 2.0)スマートリタイマーポートフォリオ(PT5161LX、PT5081LX)であり、戦略的な顧客に積極的にサンプリングされています。同社のCEOであるJitendraMohanは、次のように述べています。「CXLエコシステムへの拡張により、Astera Labsは、複雑なヘテロジニアスコンピューティングと構成可能な分解システムトポロジのロックを解除する専用ソリューションを提供するために、もう1つの大きな飛躍を遂げています。」
CXL 2.0仕様は、2020年11月にCXLコンソーシアムによってリリースされました。CXLは、ホストプロセッサとアクセラレータ、メモリバッファ、スマートなどのデバイス間の高帯域幅、低遅延の接続を使用して、コヒーレンシとメモリセマンティクスを提供するオープンな業界標準の相互接続です。 I / Oデバイス。 CXL 2.0仕様では、より多くのデバイスに接続するためのファンアウトの切り替えのサポートが追加されています。メモリ使用効率を高め、オンデマンドでメモリ容量を提供するためのメモリプーリング。永続メモリのサポート。これらはすべて、CXL 1.1および1.0との完全な下位互換性をサポートすることにより、業界の投資を維持しながら行われます。
CXLコンソーシアムの社長であるBarryMcAuliffeは、次のように述べています。急成長しているCXLエコシステムをサポートするために、最初のCXLシリコン実装が市場に登場するのを見るのは素晴らしいことです。」
Intelとのコラボレーションによる新しいPCIe5.0ソリューション
Astera Labsは、IntelXeonスケーラブルプロセッサとのPCIe接続用のAriesスマートリタイマーポートフォリオで新しい低遅延モードが利用可能になったことも発表しました。この開発は、インテルコーポレーションとの緊密なコラボレーションの結果であり、PCIeリンクのレイテンシーをサブ10nsにさらに削減し、データ中心のワークロードのパフォーマンスを向上させました。 Astera Labsは、コードネーム「SapphireRapids」のIntelXeonスケーラブルプロセッサとの堅牢なPCIe5.0相互運用性を実証した最初のベンダーであると主張しました。
また、同時に発売されるのは、Equinoxと呼ばれるPCIe / CXLアプリケーション用の新しいプラグアンドプレイスマートリタイマーアドインカードです。また、Intelとのパートナーシップで開発されたこのカードと関連する専用ファームウェアは、Intelの最新のXeonスケーラブルプロセッサを搭載したPCIe5.0対応システムの開発を簡素化します。これは、複雑なシステムトポロジを迅速に実装するための、使いやすいプラグアンドプレイボードを提供するAsteraLabsの移行を表しています。
「PCIeGen5とCXLは、現在および将来の異種コンピューティングワークロードとデータセンターアーキテクチャの基盤となるテクノロジーです」と、インテルのデータセンターエンジニアリングおよびアーキテクチャのコーポレートVP兼ゼネラルマネージャーであるZaneBallは述べています。 「インテルは、Astera Labsなどのエコシステムリーダーと協力して、コードネーム「SapphireRapids」および追加のプラットフォームでのPCIeおよびCXL相互接続の遅延を大幅に削減しています。」
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