組み込みSRAMIPは50％少ない電力を消費します

組み込みSRAMIPは、消費電力、熱放散、およびバッテリー寿命に敏感なウェアラブルおよびIoTアプリケーション向けのSoC設計を対象としています。

超低電力メモリのスペシャリストであるsureCoreは、メモリ設計で10年以上の経験を持つエンジニアを募集しています。その組み込みSRAMIPは、ウェアラブルおよびモノのインターネット（IoT）アプリケーションに対応し、電力消費、熱放散、およびバッテリー寿命に敏感なシステムオンチップ（SoC）設計を対象としています。

イギリスのシェフィールドに本拠を置くこの会社は、特別に設計されたSRAM IPがメモリ電力要件を最大50％削減できると主張しています。これは、これまで以上にインテリジェントなウェアラブル設計において非常に重要です。一方、既製のメモリを使用すると、ウェアラブルデバイスの利用可能な電力バジェットの最大50％を消費する可能性があります。

図1SRAM IPは、最大8つのシステムフレンドリーなスリープモードに細分され、独立してアクティブ、保持、または電源オフのモードになります。出典：sureCore

組み込みメモリは、多数のソフトウェアアプリケーションを実行する複数のプロセッサのサポートにより、最近のSoC設計でますます普及しています。ただし、SRAMは従来、電力を大量に消費するため、ウェアラブル電子機器やIoTアプリケーションの開発者にとって魅力的ではありませんでした。 sureCoreが行ったことは、一連の高度な回路設計技術によって動的電力と静的電力の両方を劇的に削減することです。

たとえば、シリコンで実証済みのSRAMEverOnテクノロジーを取り上げます。これは、動作をしきい値に近い電圧に拡張します。実際の制限は、ビットセルの保持電圧です。さらに低電圧動作の場合、MiniMiserレジスタファイルテクノロジは、ロジックによって提供される最小動作電圧を直接追跡します。これらのメモリソリューションは、低レベルのコンピューティングのみが必要な場合に運用能力を削減します。

図2標準のSRAMは0.9V未満では信頼性がありませんが、単一電源レールの超低電力SRAMにより、動作電圧をロジックと連動してスケーリングできます。出典：sureCore

同社は、カスタムメモリ設計サービスと超低電力IoTリファレンスプラットフォームを提供して、メモリ指向のテクノロジーを実証しています。人工知能（AI）スマートがチップ上により多くのメモリを要求するとき、より効率的なメモリソリューションのために従来のSRAMアーキテクチャの基本的な制限に挑戦しているsureCoreのような企業を見るのは興味深いことです。

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>>この記事は、もともと姉妹サイトであるEDNで公開されました。。

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