シリアル入力/シリアル出力シフトレジスタ：基礎と実用応用

データをシリアルに受信しシリアルに出力するシフトレジスタは、デジタルロジック設計の要石です。各段で1クロック周期ずつビットを遅延させ、精密なデータバッファリング、シリアル通信、クロックドメインクロッシングを可能にします。

各段は1ビットを格納するため、単段レジスタは1ビット保持。複数段をカスケードするとレジスタ長が増加—標準品で最大64ビット、複数デバイス直列接続でさらに延長可能。

以下は、システムクロックとまだ同期していないデータで駆動される単段シフトレジスタ。Dフリップフロップ（D-FF）のデータ線（ピンD)はクロックエッジまで値を保持し、その後その値が出力ピンQに現れます。

 

 

重要な点—次の図とは異なり—Dピンに存在するデータが、クロック立ち上がりエッジで正確にQに転送されること。入力がエッジの前後で十分安定しているため、フリップフロップは正しい値を捕捉します。

ポジティブエッジトリガフリップフロップでは、出力がクロック遷移直後に入力に追従します（上向き矢印で示す）。

マルチ段シフトレジスタでは、入力データがクロックエッジ付近で変化する場合があります。その場合でも、フリップフロップはエッジ直前の値をサンプリングし、エッジで発生した変化は次のクロックパルスまで無視されます。

 

 

したがって、データがクロックに適切に同期されている限り、D-FFは1クロック周期遅延素子として機能。出力波形は入力の遅延コピーで、1クロックサイクルシフトします。

タイミングを説明するため、Texas InstrumentsのCD4006B 18ビットシリアル入力/シリアル出力シフトレジスタを考察。データシートは5V DC動作で以下の主要パラメータを指定：

• セットアップ時間 (t_S) = 100 ns
• ホールド時間 (t_H) = 60 ns
• 伝播遅延 (t_P) = 200–400 ns (典型/最大)

これら値により、Dピンに提示されたデータがクロックエッジ少なくとも100 ns前から安定し、その後60 ns変化しないことが保証。1 MHzクロック（1 µs周期）ではセットアップとホールドマージンが快適に満たされます。

カスケード接続時、各段の出力（Q）が次段の入力（D）に供給。伝播遅延（200 ns）がホールド時間を超えるため、データは遷移中も有効であり、信頼性ある動作を保証。

 

 

同じ概念がJKフリップフロップにも適用され、QをJに、Q'をKに接続して等価シフトレジスタを形成。

シリアル入力/シリアル出力（SISO）シフトレジスタは、単一データ入力、クロック入力、最終段に現れる単一出力を持つ。中間出力は通常露出せず、シリアル入力/並列出力（SIPO）レジスタと区別されます。

3段SISOレジスタでは、以下の波形が3ビットの各段伝播（各1クロック遅延）を示します。

 

 

Texas Instruments製シリアル入力/シリアル出力デバイス

以下のTexas Instruments製品が上記概念を例示：

• CD4006B – 18ビット SISOシフトレジスタ
• CD4031B – 64ビット SISOシフトレジスタ
• CD4517B – 内部タップ付きデュアル64ビット SISOシフトレジスタ

これらは4000シリーズCMOSデバイスで、正電源（V_DD）3V〜15V、V_SS接地で動作。典型的最大クロック周波数は電源電圧により数MHz。

 

 

CD4006Bは内部4ビットと5ビット段をカスケードして18ビットレジスタとして構成可能。内部タップにより、より短いシフトレジスタを必要とするアプリケーション向けに4ビット出力も可能。

 

 

CD4031Bは完全64ビットSISOシフトレジスタを提供。追加出力Q₆₄とQ₆₄'、半段遅延出力（半クロック遅延）を含む。モード制御入力で2データソース（データ1またはデータ2）選択可能、所望時にデータ再循環を実現。

 

 

モード制御がハイ時、出力Q₆₄がデータ入力にルーティングバックされ、64サイクルフィードバックループを形成。繰り返しパターンやサーキュラバッファ実装に有用。

 

 

CD4517Bは2つの独立64ビットシフトレジスタ（セクションAとB）を提供。各セクションに独自クロック、データ入力、書き込みイネーブル（WE）。16, 32, 48段の内部タップで、16ビット、32ビット、48ビットレジスタとして柔軟に再構成可能。

 

 

例：セクションBを16ビットレジスタとして構成するには、WE_Bをグラウンド、CL_Bにクロック供給、Q_16Bから遅延出力読み取り。セクションAを同時にフル64ビットレジスタとして使用することも同原理で可能。

 

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