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Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス

概要

300 nm SiO₂/Si(100)基板上でアモルファスシリコンナノワイヤー(α-SiNW)を触媒フリーで直接合成するシンプルな手法を実証。スパッタリング堆積・フォトリソグラフィパターニングしたミクロンスケールCuパターンが、Ar/H₂雰囲気1080℃ 30分アニーリング時に固-液-固(SLS)触媒として機能。CuパターンがSiO₂と反応しCuシリサイド形成、Si原子供給拡散チャネル創出。ワイヤー長はアニーリング時間に線形スケール(30分で24 μm)、直径81 nmから57 nmへ減少、室温抵抗率2.15×10³ Ω·cm。低温・有毒ガスフリー・プロセスでナノワイヤー密度、位置、寸法精密制御可能、CMOS互換デバイス統合へ道開く。

背景

シリコンナノワイヤー(SiNW)はエレクトロニクス、光伏、フォトニクス、電池、センシング技術で極めて重要。従来トップダウン法(反応性イオンエッチング、金属触媒電解エッチング、MEMSパターニング)は優れた位置制御可能だが高価リソグラフィや複雑工程必要。ボトムアップ化学気相成長(CVD)でAu等金属触媒用い高品質超薄SiNW得られるが、CMOS処理非互換汚染導入。最近の触媒フリーアプローチ(酸化物助成長、レーザーアブレーション)は統合互換性欠如や有害材料必要。銅はIC配線材として熱的・電気的特性で広く用いられ、深準位不純物導入なしでCMOS互換触媒として魅力的。本研究ではSiO₂上Cu媒介SLS成長でα-SiNW合成、有毒前駆体回避とデバイスグレード清浄度維持実現。

実験方法

チップ作製

n型Si(100)ウェハー上に300 nm SiO₂熱酸化成長(図1a)。400 nm Cu膜スパッタリング、標準フォトリソグラフィと過硫酸アンモニウムエッチングで直径1.9 μm、厚400 nmミクロンパターンアレイ形成(図1b)。チップダイシング後、エタノール、アセトン、脱イオン水順次洗浄、N₂ブロー乾燥。

Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス
作製プロセス模式図。a 熱酸化。b Cuパターンアレイ。c Cu半球。d ナノワイヤー成長。

α-SiNW成長

チップを石英ボート搭載、炉をAr 1000 sccmで10分パージ。5温度ステージ適用(図2):(I) 1時間で400℃昇温(Arのみ);(II) 2時間で1080℃昇温(100 sccm Ar + 20 sccm H₂);(III) 1080℃ 30分保持(1000 sccm Ar + 40 sccm H₂);(IV) 急冷(10分、500 sccm Ar + 20 sccm H₂);(V) 緩慢室温冷却(100 sccm Ar + 20 sccm H₂)。CuパターンがデューイングしCuシリサイド形成、Si原子拡散チャネル供給しパターン部位でα-SiNW析出。

Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス
熱処理ダイアグラム。ステージ詳細本文参照。

評価

SEM(Hitachi S-4800)とHR-TEM(JEM-2100F, 200 kV)EDSでモルフォロジーと組成評価。TEM試料Moグリッド搭載、FIB加工根元を薄Au層保護。二端子抵抗率測定にカスケードHP 4156プローブステーション、FIB作製Pt溶接デバイス使用。

結果と考察

アニーリング前後SEM像(図3)で顕著差異:連続Cu膜(試料I)がアニーリング後ランダムCuボール(約4.4 μm)形成、一方Cuパターンアレイ(試料II)がパターン毎単一α-SiNW(約57 nm径、20 μm長)生成、パターンピッチ(10 μm)直接反映。ミクロンCuパターンが制御されたナノワイヤー核生成と密度に必須確認。

Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス
30分アニーリング前後SEM。a Cu膜アニーリング前。b Cu膜アニーリング後(Cuボールサイズ分布)。c Cuパターンアレイアニーリング前。d ナノワイヤー成長後。

HR-TEM(図4)でワイヤー完全アモルファス確認;SAED拡散リングパターン、EDSでSi:O比約4、最小酸化示唆。Ar/H₂雰囲気成長、表面酸化は成長後大気曝露起因。

Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス
α-SiNW HR-TEM。a ナノワイヤー先端。b SAEDパターン。c EDSスペクトル。

断面SEM(図5)でワイヤー起源がSi/SiO₂界面、顕著Siギャップ出現、基板からSi拡散が成長材料供給(Cuではない)証明。ワイヤー先端に金属粒子観察されず、CuシリサイドがSi溶解・再析出でワイヤー形成するSLS機構支持。

Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス
α-SiNW根元断面SEM 45°。Si/SiO₂界面にSiギャップ出現。

成長経路を図6模式化:Cuデューイング、シリサイド形成、Si拡散、α-SiNW析出。Cu高温Si急速拡散が最終ワイヤーCu不在説明。

Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス
Cu媒介SLS成長模式図。

マッピング(図7)でワイヤー先端・根元にCu不在確認、拡散駆動成長機構支持。

Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス
ワイヤー先端TEM/EDSマッピング。Cu検出されず。

アニーリング時間依存性(図8)で均一径ながら微細テーパー:根元径(約49 nm)< 先端径(約76 nm)、成長中径収縮示唆。平均径30分で81 nmから57 nmへ減少。

Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス
異なるアニーリング時間でのα-SiNW SEM像。

長さ対アニーリング時間(図9)で成長速度約1.1 μm/min、VLS成長SiNWと同等。急速堆積で結晶秩序形成阻害、アモルファスワイヤー生成。径経時減少はCu拡散深化に伴うCuシリサイド体積減少反映。

Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス
長さと径対アニーリング時間。

電気測定(図10)で準オミックI-V挙動。測定抵抗率(2.15×10³ Ω·cm)はドープ単結晶Siワイヤーより1桁高く、アモルファス構造とサイズ依存伝導と整合。

Cu触媒によるSiO₂上アモルファスSiナノワイヤー成長:アニーリング法によるシンプル・無汚染プロセス
α-SiNW電気伝導。二探針法抵抗率測定。

結論

Ar/H₂雰囲気アニーリングでCu触媒α-SiNWをSiO₂上成長させるシンプル・スケーラブルルート確立、有毒前駆体回避と金属汚染最小化。Cuパターニングでワイヤー密度・位置制御、アニーリング時間で径(57-81 nm)と長さ(最大24 μm)調整。室温抵抗率2.15×10³ Ω·cm示し、将来CMOS互換ナノデバイスへの可能性確認。

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